zoukankan      html  css  js  c++  java
  • verilog day3

    005.十进制转换为二进制编码:127,-127,127.375,-127.375

    006.画出CMOS三态缓冲器的电路原理图,解释一下高阻态。

    007.什么是open-drain output?

    计算机系统的各部件模块(Module)及芯片(Chip)通常挂接在系统总线(System bus)上,在某一时刻只能有一个发送端。为了使各模块芯片能够分时传送信号,需要具有三态输出的门电路,简称三态门(Three-state gate),又称为三态缓冲器(Three-state buffer)三态门的输出端状态不仅有高电平和低电平,而且具有第三种状态--高阻状态(High-Impedance,Hi-Z).

    CMOS三态门是在普通门的基础上增加了控制端和控制电路。CMOS三态门的电路结构有很多种,大体可以分为以下3类:

    1. 控制上下P/N沟道的截止或导通,实现三态输出功能。如下图(a)、(b)。

    2. 在输出端串联传输门开关(TG)的三态线路。如下图(c)。

    3. 利用或非门或者与非门实现三态功能。如下图(d)(e)

    OD门就是将反相器的上面的PMOS管拿掉了而已,当两个与非门的输出全为1时,输出为1;只要其中一个输出为0,则输出为0,所以该电路符合与逻辑功能,即L=(AB)'(CD)'。

  • 相关阅读:
    论文(卷积数据流)-Communication Lower Bound in Convolution Accelerators
    CPU架构相关
    Verilog-数据包检测器
    多比特乘法器的分解
    Verilog-数字时钟无毛刺切换
    Booth乘法器
    C++:地平线2019相关题
    C++:char数组和string类
    C++:strcpy函数
    半导体 semiconductor 相关知识
  • 原文地址:https://www.cnblogs.com/baihuashan/p/11691845.html
Copyright © 2011-2022 走看看