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  • 时序逻辑电路

    组合逻辑电路的基本单元是门电路

    时序逻辑(具有记忆功能)电路的基本单元是触发器

    触发器定义:

      能够记忆一位二值信号地基本逻辑电路。也是构成时序电路的基本单元电路

    触发器特点:

      具有俩个能自行保持的稳定状态,1态和0态;根据不同的输入信号可以置成1或0状态;输入信号消失后获得的新状态能够自动保持下来。

    触发分类:

      电路结构的不同:基本触发器,同步触发器(比基本触发器多了cp控制信号,实现了只能在时钟信号到达时,输入信号才起作用),主从触发器(俩个同步触发器组成,一个主触发器一个从触发器,cp控制用非门连接,解决了空翻问题),边沿触发器

      逻辑功能不同:RS触发器,JK触发器,D触发器,T触发器和T‘触发器

      存储数据的原理不同:静态触发器和动态触发器;静态触发器是依靠电路状态的自锁(反馈)存储数据,动态触发器是通过mos管栅极输入电容中存储电荷来存储数据

      稳定状态的特点:双稳态触发器,单稳态触发器

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  • 原文地址:https://www.cnblogs.com/wanjn/p/7774261.html
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