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  • Verilog HDL中的运算符关系


    1,位运算符 

     按位运算的运算符是位运算符,原来的操作数有几位,结果就有几位,若两个操作数位数不同,则位数短的操作数左端会自动补0 

    (1),按位取反:

    (2),按位与:

    (3),按位或:

    (4),按位异或:

    (5),按位同或:^~~^

    2,缩位运算符(又称归约运算符) 

     缩位运算符是单目运算符,按位进行逻辑运算,结果是一位值! 

    (1),与缩位运算符:

    (2),或缩位运算符:

    (3),异或缩位运算符:

    (4),与,或,异或运算符和非运算符组成的复合运算符:~&~|,~^

     

    3,逻辑运算符(逻辑关系运算) 

    (1),逻辑与:&& 

    (2),逻辑或:|| 3),逻辑非:!  其中,逻辑与和逻辑或是双目运算符,逻辑非是单目运算符。  如果操作数是多位的,则将操作数看做整体,若操作数中每一位都是0值则为逻辑0值,若操作数当中有1,则做位逻辑1值。



    注意:在verilog中符号图形的区别

    与门:

    同或:



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  • 原文地址:https://www.cnblogs.com/wandashuai/p/10741070.html
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