Quartus II 中Tsu/Tco 的约束方法片内的Tsu/Tco
是指前级触发器的Tco 和后级触发器的Tsu, 一般来说都是几百ps 级别的. 可以通过“List Paths”命令查看。这里的Tsu/Tco
主要由器件工艺决定, 工作时在受到温度,电压的影响略有变化.(如下图所示)
管脚上的Tsu/Tco 它是保证系统Famx 重要的Timing 元素(如下图示). 比如: 两个芯片之间工作在100MHZ, 因为100M 的周期为10ns,
(现忽略PCB 走线的延迟), 如果某信号对FPGA 来说是输入,那么前级芯片的Tco 加上FPGA 的Tsu 就不能够超过10ns. 如果某信号对于FPGA
来说是输出,那么FPGA 的Tco 加上后级芯片的Tsu 也不能够超过10ns. 只有这样,才能够保证片间通信正常。因此对FPGA
的管脚进行适当的Tco/Tsu 的时序约束,是至关重要的Timing 设计技巧. 管脚上的Tsu/Tco 分为以下三个部分.
IOE 走线的延迟. 这个延迟在管脚的Tsu/Tco 延迟中占有相当的比例,Altera 的器件为了降低Tsu/Tco 在IOE 上的延迟, 专门在IOE
中设置了两种类型的触发器, 即 : Fast Input Register(FPGA 的管脚为输入时,优化Tsu), Fast Output
Register(FPGA 的管脚为输出时,用于优化Tco)
触发器的Tsu/Tco 的需求,这里的Tsu/Tco, 这是由器件工艺决定的,最小的Tsu/Tco 的要求.
在实际的工作环境中,受温度,电压的变化有微小的变化.
Quartus II 有四处可以对Tsu/Tco 进行约束. 1. 全局时序约束. 在Quartus II 中执行Assignments→Timing Setting 弹出如下界面.设计者可以根据系统Fmax 的要求去约束Tsu/Tco.
2. 执行Assignments→Assignment Editor 命令,得到如下界面.设计者可以根据本设计的要求,对输入/输出管脚设置Tsu/Tco
的约束;也可以约束内部触发器的Tsu/Tco 的值。(如下图所示)
3. 修改布线后的底层电路.
执行Processing→Compilation Report 命令. 在Resource Section→Input Pins/Output Pins
中选中对应的输入输出管脚(如下图所示).
选中的管脚在Chip Editor 中已经被HighLight(如上图所示). 双击Highlight 的的管脚,得到下图界面. 这里的参数就是该管脚在布线后所有的参数,并不是每个参数都可以修改.比如: 对LVDS 电平标准,Current Strength 就不能够修改等.对于LVTTL 电平标准,Current Strength就有2,4,8,16,24mA 可以修改. 设计者可以根据设计的需求来Enable 或者Disable Fast Input Register/Fast Output Register属性,可以修改输入管脚到逻辑阵列的延迟和输出管脚到逻辑阵列的延迟等.
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